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开课时间:2020年8月10日
课程介绍
目前只要涉及到数字IC设计的公司,都必不可少的需要等效性验证工程师,等效性检查在整个design设计过程中占据着重要的作用。
Formality是SYNOPSYS的等效性验证方案,该工具使用静态形式技术来确定某一设计的两个版本之间是否具有等效功能。Formality 能够支持先进的综合优化、布局布线技术等等,减少流片失败风险,缩短设计周期。
本课程以模拟公司项目的方式授课,配套上机练习,使学员熟悉形式验证的flow,并以具体的实例,获得一次从setup环境到debug的经验,顺利通过高薪数字IC工程师的招聘。
课程共40课时,20课时(课程) + 16课时(LAB) +4课时(项目实践)!
课程适合对象
(1)在学校没有数字IC设计实践机会的理工科类专业在校研究生和本科生。
(2)从事前端或后端数字IC设计的在职工程师,希望深入了解等效性验证原理、积累项目实践检验、提升自身的IC设计能力。
课程主要内容
等效性验证原理介绍,Formality的基本概念reference,implementation,logic cone等,验证的基本flow,GUI界面介绍。
分别介绍Formality的几个Step,Guidance,read,setup,match,verify。
Multiple stage 验证及SVF,介绍如何分多个阶段去验证,如何解读SVF中的内容。
Hardverification介绍当遇到inconclusive如何解决。
Multi-voltagedesigns如何去验证,Formality支持带UPF的验证。
如何高效debug,介绍当遇到fail该如何高效的debug,根据不同的现象找到导致fail的原因。
基于ARM Cortex M4的CPU项目工程实践
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并另附赠以下套餐独享课时: | ||
1.数字设计理论基础 | ||
2.数字设计流程介绍及演示(前端设计,验证) | ||
3.后端笔试题讲解 | ||
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